Zentrale öffentliche Logbücher

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• 15:32, 23. Dez. 2025 IsabelMorehead Diskussion Beiträge erstellte die Seite Ferrite Core Memory Module (Die Seite wurde neu angelegt: „<br>Reading, writing, and repairing. 1. I screwed up the design of the Inhibit module, so I can solely write 1 zero in a byte. I have corrected the module design, [https://git.rbsx.de/dorie347375148/8802425/wiki/Thus%2C-B%27s-Successor%2C-C%2C-was-Born MemoryWave Guide] and i anticipate the corrected boards to arrive any day now. 2. The system currently takes about 30 mins to warm up. If I run a steady memory test on the cores (writing 0xFFs/0xEFs), a se…“)